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類型

電路方案

編碼器 Quartus
摩爾斯電碼編碼器設(shè)計(jì)VHDL代碼Quartus仿真

FPGA代碼設(shè)計(jì)學(xué)習(xí)資料

04/23 08:37

850
FPGA Quartus
出租車計(jì)費(fèi)器控制電路設(shè)計(jì)VHDL代碼Quartus? AX301開(kāi)發(fā)板

FPGA代碼設(shè)計(jì)學(xué)習(xí)資料

04/23 08:32

804
FPGA 數(shù)碼管
 EDA程序設(shè)計(jì)-數(shù)字電壓表設(shè)計(jì)

白茶丫

2024/11/26

2677
FPGA 數(shù)碼管
 EDA程序設(shè)計(jì)-洗衣機(jī)控制器設(shè)計(jì)

白茶丫

2024/11/25

2649
可編程邏輯控制器車燈控制
 EDA程序設(shè)計(jì)--汽車尾燈

白茶丫

2024/11/14

1954
FPGA 數(shù)碼管
 EDA程序設(shè)計(jì)-數(shù)字跑表

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2024/11/13

1567
程序源碼可編程邏輯控制器
 EDA程序設(shè)計(jì)-萬(wàn)年歷設(shè)計(jì)（VHDL語(yǔ)言）

白茶丫

2024/10/04

2277

文章

摩爾斯電碼編碼器設(shè)計(jì)VHDL代碼Quartus仿真
名稱：摩爾斯電碼編碼器設(shè)計(jì)VHDL代碼Quartus仿真。代碼功能：使用有限狀態(tài)機(jī)（FSM）來(lái)實(shí)現(xiàn)摩爾斯電碼編碼器，實(shí)現(xiàn)ABCDEFGH這些字母的摩斯電碼。

FPGA代碼設(shè)計(jì)學(xué)習(xí)資料

1052

04/14 11:05

Quartus vhdl
編寫高效的Testbench
Testbench是驗(yàn)證HDL設(shè)計(jì)的主要手段，本文提供了布局和構(gòu)建高效Testbench的指南以及示例。另外，本文還提供了一種示例，可以為任何設(shè)計(jì)開(kāi)發(fā)自檢Testbench。

FPGA技術(shù)實(shí)戰(zhàn)

1856

2024/10/15

VHDL設(shè)計(jì) Testbench
基于FPGA的UART控制器設(shè)計(jì)（VHDL）（中）
今天給大俠帶來(lái)基于FPGA的 UART 控制器設(shè)計(jì)（VHDL）（中），由于篇幅較長(zhǎng)，分三篇。今天帶來(lái)第二篇，中篇，RS-232 串口通信簡(jiǎn)介。話不多說(shuō)，上貨。

FPGA技術(shù)江湖

2635

2024/02/16

FPGA 串口通信
基于FPGA的UART控制器設(shè)計(jì)（VHDL）（上）
今天給大俠帶來(lái)基于FPGA的 UART 控制器設(shè)計(jì)（VHDL）（上），由于篇幅較長(zhǎng)，分三篇。今天帶來(lái)第一篇，上篇，計(jì)算機(jī)接口技術(shù)簡(jiǎn)介RS-232 串口通信簡(jiǎn)介。話不多說(shuō)，上貨。

FPGA技術(shù)江湖

3054

2024/02/15

FPGA 串口通信
筆記 | VHDL設(shè)計(jì)方法學(xué)
Verilog是一種硬件描述語(yǔ)言，作用是進(jìn)行電路設(shè)計(jì)，可以描述電路的功能、連接和時(shí)序。他關(guān)心的不僅是從功能邏輯這個(gè)問(wèn)題如何解決，更關(guān)心這些功能如何實(shí)現(xiàn)，關(guān)心最終的電氣連接。可綜合的Verilog代碼經(jīng)過(guò)綜合后，最終會(huì)轉(zhuǎn)化為實(shí)際電路。

志芯

484

2023/01/06

c語(yǔ)言 VHDL設(shè)計(jì)

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