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類型

電路方案

電容數(shù)碼管
 基于proteus仿真的電容表數(shù)電純硬件設(shè)計（仿真圖、設(shè)計論文）

無限星空

2024/07/16

1775

文章

數(shù)字芯片設(shè)計中為什么用于仿真和性能評估的算法不一樣？
在芯片開發(fā)過程中，算法的作用貫穿整個設(shè)計和驗證流程，但不同階段的算法側(cè)重點和實現(xiàn)方式各不相同。我們可以從目標、精度、實現(xiàn)方式、計算效率等幾個維度來理解。

老虎說芯

972

02/19 11:20

仿真數(shù)字芯片
如何理解數(shù)字芯片設(shè)計中的RTL（Register Transfer Level）
RTL（寄存器傳輸級）是數(shù)字電路設(shè)計中對硬件功能進行抽象描述的一種層次。它的“主角”是寄存器和寄存器之間的數(shù)據(jù)通路，即在一個時鐘周期內(nèi)，信號會從寄存器輸出，經(jīng)過組合邏輯運算，最后進入下一級寄存器。

老虎說芯

1.1萬

02/10 12:00

數(shù)字芯片 rtl
數(shù)字芯片設(shè)計驗證經(jīng)驗分享系列文章（第四部分）：將ASIC IP核移植到FPGA上
本系列文章從數(shù)字芯片設(shè)計項目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計和驗證規(guī)劃進行結(jié)合，詳細講述了在FPGA上使用IP核來開發(fā)ASIC原型項目時，必須認真考慮的一些問題。文章從介紹使用預(yù)先定制功能即IP核的必要性開始，通過闡述開發(fā)ASIC原型設(shè)計時需要考慮到的IP核相關(guān)因素，用八個重要主題詳細分享了利用ASIC IP來在FPGA上開發(fā)原型驗證系統(tǒng)設(shè)計時需要考量的因素。

與非網(wǎng)編輯

1989

2024/08/29

FPGA ASIC
數(shù)字芯片設(shè)計驗證經(jīng)驗分享：將ASIC IP核移植到FPGA上
本文從數(shù)字芯片設(shè)計項目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計和驗證規(guī)劃進行結(jié)合，詳細講述了在FPGA上使用IP核來開發(fā)ASIC原型項目時，必須認真考慮的一些問題。文章從介紹使用預(yù)先定制功能即IP核的必要性開始，通過闡述開發(fā)ASIC原型設(shè)計時需要考慮到的IP核相關(guān)因素，用八個重要主題詳細分享了利用ASIC所用IP來在FPGA上開發(fā)原型驗證系統(tǒng)設(shè)計時需要考量的因素。本篇文章是Smart

與非網(wǎng)編輯

1681

2024/07/26

FPGA ASIC
談?wù)剶?shù)字芯片中的握手協(xié)議
在芯片中，握手是最古老的跨時鐘域之間傳輸數(shù)據(jù)的方式。握手機制通過將脈沖信號展寬，待輸出一側(cè)檢測到信號并將其解析為脈沖信號后，再向輸入一側(cè)發(fā)送應(yīng)答信號，表明接收到信號并且傳輸完成。

知芯情報局

1.5萬

2024/05/13

數(shù)字芯片握手協(xié)議

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